• 270.25 KB
  • 2022-04-22 11:30:47 发布

数字逻辑与数字系统 第四版 (白中英 著) 科学出版社 课后答案 chapter3 课后答案【】

  • 15页
  • 当前文档由用户上传发布,收益归属用户
  1. 1、本文档共5页,可阅读全部内容。
  2. 2、本文档内容版权归属内容提供方,所产生的收益全部归内容提供方所有。如果您对本文有版权争议,可选择认领,认领后既往收益都归您。
  3. 3、本文档由用户上传,本站不保证质量和数量令人满意,可能有诸多瑕疵,付费之前,请仔细先通过免费阅读内容等途径辨别内容交易风险。如存在严重挂羊头卖狗肉之情形,可联系本站下载客服投诉处理。
  4. 文档侵权举报电话:19940600175。
'课后答案网,用心为你服务!大学答案---中学答案---考研答案---考试答案最全最多的课后习题参考答案,尽在课后答案网(www.khdaw.com)!Khdaw团队一直秉承用心为大家服务的宗旨,以关注学生的学习生活为出发点,旨在为广大学生朋友的自主学习提供一个分享和交流的平台。爱校园(www.aixiaoyuan.com)课后答案网(www.khdaw.com)淘答案(www.taodaan.com) 第三章时序逻辑1.写出触发器的次态方程,并根据已给波形画出输出Q的波形。Q(n1)(bc)aQ(n)解:abc12.说明由RS触发器组成的防抖动电路的工作原理,画出对应输入输出波形解:3.已知JK信号如图,请分别画出主从JK触发器和负边沿JK触发器的输出波形(设触发器的初态为0) 4.维持-阻塞D触发器输入波形如图,画出触发器各个与非门所对应的输出波形解:5.写出下图所示个触发器次态方程,指出CP脉冲到来时,触发器置“1”的条件。解:Y1Y2Y3QQQRSDKJCPCPCPS=A+C+BC+AB=0ABBCCAABCDBAD=A+B=1Qn+1=S+RQnQn+1=DQn+1=JQn+RQnRS=0(约束条件)J=A+B+C+D=16.写出各触发器的次态方程,并按所给的CP信号,画出各触发器的输出波形(设初态为0)解: 7.下图是一种两拍工作寄存器的逻辑图解:(1)设触发器初始状态为0。当D2D1D0=100→001→010时,输出Q2Q1Q0将为100→101→111。(1)若采用RS触发器。有以下(a)、(b)两种方案:QQQ210RSRSRSQQQ210QQQDDD接收控制接收控制D2D1D0D2D1D0(a)(b)8.设计实现8位数据的串行→并行转换器。SRQA74LS299G1A/QAD27QBC/QCD6D5D/QDD4E/QES1M0D3QEF/QF3D2SLG/QGD1QGH/QHD0QHCREN1CDQ 9.分析下图所示同步计数电路解:先写出激励方程,然后求得状态方程QnQnQnQn+1Qn+1Qn+1123123000100001100010001Qn+1=QnQn+QnQn01100112131100110Qn+1=Qn10101021110111Qn+1=Qn1110113200010011011110101000101110.作出状态转移表和状态图,确定其输出序列。解:D=Qn+1=QnQn1123101000100110D=Qn+1=Qn221D=Qn+1=Qn010001011111332输出序列:0001111.用D触发器构成按循环码(000→001→011→111→101→100→000规律工作的六进制同步计数器解:先列出状态方程,然后求得激励方程PSNS输出 nnnn1n1n1QQQQQQN210210000001000101100111110111101010110001000001化简得:nnZQQ20n1nnnQQQQ2120n1nnQQQ120n1nnQQQ021电路图:Q0Q1Q201212.用D触发器设计3位二进制加法计数器,并画出波形图。解:QnQnQnQn+1Qn+1Qn+1123123000001001010010011011100100101101110110111111000 DQQ(QQ)Q220210DQQ110DQ0013.用下图所示的电路结构构成五路脉冲分配器,试分别用简与非门电路及74LS138集成译码器构成这个译码器,并画出连线图。解:先写出激励方程,然后求得状态方程QnQnQnQn+1Qn+1Qn+1123123000110001110010100Qn+1=Qn+QnQn=Qn+Qn011101113113100111Qn+1=Qn+QnQn=Qn+Qn101010221221110111Qn+1=QnQn+QnQn11101131323译码器功能表QnQnQnYYYYY123012340101000010001000111001000110001010100001000110Φ001若用与非门实现,译码器输出端的逻辑函数为:YQQ013YQQ113YQQ212YQQ313YQQ423若用译码器74LS138实现,译码器输出端的逻辑函数为: YQQQ0123YQQQ1123YQQQ2123YQQQ3123YQQQ412374LS138G1Y0G2AY0G2BY3YQA130Y4QA21Q1A2Y7Y214.用74LS290构成模为8和9的计数器,各采用两种方案画出其接线图解:74LS29074LS290CPCP1QACP1QACP2QBCPCP2QB(a)模8计数器R01QR01QCCR02QR02QDDS91S91S92S9274LS29074LS290CPCP1QACP1QA(b)模9计数器CP2QBCPCP2QBR01QR01QCCR02QR02QDDS91S91S92S92 74LS29074LS290CPCP1QACP1QA(b)模9计数器CP2QBCPCP2QBR01QR01QCCR02QR02QDDS91S91S92S9215.若将下图接成12进制加法器,预置值应为多少?画出状态图及输出波形图。解:预置值应C=0,B=1,A=1。ENPQDQCQBQACOENT74LS169LDUCPDCBAD01116.用一片74LS163计数器和2片74LS138译码器构成一个具有12路脉冲输出的数据分配器。画出连接图,在图上标明第1路到第12路输出的位置解:74LS1381G1Y0Y0YQG132AY2G2BY3YQA422Y5QA11Y6YY......YQ0A0Y7Y70111......G1Y0Y8译码器Y0G92AY10G2BCOQ3Q2Q1Q0A21ENP74LS163LENTDAC11CPDDDDR3210A0Y7Y11111174LS138 17.改用一片74LS195移位寄存器来代替上题中的74LS163,完成同样的设计解:74LS1381G1Y0Y0YQG132AY2G2BY3YQA422YYY......Y50111Q1A1Y......6Q0A0Y7Y7译码器G1Y0Y8Y0G92AY10G2BQ3Q3Q2Q1Q0JM1A274LS1951KAR1CPDDDD3210A0Y7Y1174LS13818.分析下图所示同步时序逻辑电路,作出状态转移表和状态图,说明它是Mealy型电路还是Moore型电路以及电路的功能。解:电路的状态方程和输出方程为:n1nQQ11n1nnnnQ(XQ)Q(XQ)Q21212nnZQQ12X=000/110/1X=1Qn+1Qn+1/ZQnQn1212X=0X=1X=0X=1X=1X=00010/111/10111/110/1X=11001/100/111/001/11100/001/0X=0该电路是Mealy型电路。当X=0时,电路为模4加法计数器; 当X=1时,电路为模4减法计数器19.分析下图所示同步时序逻辑电路,作出状态转移表和状态图,说明这个电路能对何种序列进行检测?解:电路的状态方程和输出方程为:0/0X/Z000/00/1Qn+1Qn+1/ZQnQn12121/0X=0X=110010/10000/001/00101/110/01/01/01011/010/0111111/100/01/0凡输入序列“110”,输出就为“1”。20.作“101”序列信号检测器的状态表,凡收到输入序列101时,输出为1;并规定检测的101序列不重叠。解:解:根据题意分析,输入为二进制序列x,输出为Z;且电路应具有3个状态:S0、S1、S2。列状态表和状态图如下:0/0PSNS/ZS0X=0X=1S0S0/0S1/01/11/0S1S2/0S1/0S2S0/0S0/10/0S0S01/00/0 21.同步时序电路对串行二进制输入进行奇偶校验,每检测5位输入,输出一个结果:当5位输入中1的数目为奇数时,在最后一位的时刻输出1。作出状态图和状态表。解:题目要求对有限长度的串行序列进行的奇偶校验。一方面对于每接收到一位码后都要断定一下到目前为止接收的数据中1的数目是奇数还是偶数;另一方面还要记忆到目前为止已收到了几位数据。为此,电路的状态表和状态图如下:A0/01/0sx01BC1/01/0AB/0C/00/00/0BD/0E/0CE/0D/00/10/0DEDF/0G/01/01/0EG/0F/00/00/0FH/0I/01/11/0FGGI/0H/01/01/0HA/0A/10/00/0IA/1A/0HI偶数奇数22.简化下列完全定义时序电路状态表为最简状态表BCDEFGHABCDEFGHI 23.对下面的时序电路状态表进行状态编码,作出编码后的状态转移表,并用D触发器和与非门加以实现解:B×C××NS,ZD×××PSX=0X=1E×××?S0S2,1S3,1SS,0S,1112F×××??SS,1S,0220ABCDESS,0S,0332S0S10/00/11/11/11/00/0S31/0S20/124.某时序机状态图如下图所示。请用“一对一法”设计其电路k=0k=0S01000k=1k=1k=1k=1k=0k=0k=0k=0S3S100010100k=0k=1k=0k=1S20010k=1k=1n1nnDQQKQK0003n1nnDQQKQK1101n1nnDQQKQK2221n1nnDQQKQK3323 25.某时序机状态图如下所示,用“计数器法”设计该电路k=0k=0S000k=1k=1k=1k=1k=0k=0k=0k=0S3S11101k=0k=1k=0k=1S210k=1k=1若编码为:S0=00S1=01S2=11S3=10:则次态方程为:n1nnQKQKQ112n1nnnnQKQKQQQ21212若编码为:S0=00S1=01S2=10S3=11,则次态方程为:n1nnnQkQk(QQ)1121n1nnnnQk(QQ)QQk2121226*.设计4bit串/并转换电路,实现4位二进制码的串→并转换。要求通过标志位信号的设置和控制,使电路能自动连续地实现转换27.*28.设计一个巴克码信号发生器,要求自动产生周期性的1110010信号序列。可以用移位寄存器实现,也可以用同步时序电路实现/1/1/1S0S1S2S3/0/0S6S5S4/1/0 DDDQ0Q1Q2CP'

您可能关注的文档